FFT復數處理器設計與FPGA驗證
楊國波; 婁皓翔; 江禮東; 劉躍元; 王漕 成都理工大學; 四川成都610059
關鍵詞：fft處理器 流水線 復數
摘要：本文介紹了一種基于現場可編程門陣列(FPGA)的快速傅里葉變換(FFT)復數處理器設計,可進行1024點復數計算。采用按時間抽取的基-4算法和基于RAM的蝶形結構。同時對最后一級旋轉因子進行了優化,減少了存儲器的資源占用。使用流水線的處理結構,控制器簡單。最后定點matlab建模與Synopsys的仿真器VCS仿真結果進行了對比,功能正確。完成整個運算僅用了2064個周期。最后用Altera公司的Cyclone IV E系列EP4CE10E22C8芯片完成原型驗證,在時鐘頻率為50MHz時,完成1024點復數FFT僅用41.28μs。
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